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發(fā)布時(shí)間: 2009-8-4 20:45
正文摘要:本帖最后由 changyongid 于 2009-8-4 23:37 編輯 大家好,我在用cadence建立元件庫,畫(huà)cpu的時(shí)候遇到了一個(gè)問(wèn)題.. 如圖....是在畫(huà)cpu的第三部分時(shí)出現的.. 那幾個(gè)引腳的名字都相同...不知道這個(gè)時(shí)候該怎么 ... |
學(xué)習中。。。。。。。! |
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學(xué)習! |
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看看 |
名稱(chēng)重復這個(gè)警告 沒(méi)什么影響吧? |
推薦兄弟去看看于博士的教程,里面都有說(shuō)到! |
學(xué)習…… |
關(guān)于原理圖中管腳的類(lèi)型,上面回答了一些,具體分為:三態(tài)門(mén),雙向信號,輸入,開(kāi)路集電極,開(kāi)路發(fā)射極,輸出,無(wú)源端,電源 比如一個(gè)最簡(jiǎn)單的二輸入與非門(mén)74LS00, 一個(gè)門(mén)電路起碼有2個(gè)輸入一個(gè)輸出,還有電源地,那么定義的時(shí)候就是input output, power了,VCC和GND都輸入POWER類(lèi)型的,還有別的與非門(mén)有使能端就是輸入啦 |
我的理解是電源pin,比如GND,5V,3V什麼VCCpin,設置為power. 如果該pin在你的電路中是輸入信號的引腳,那么你要把這個(gè)腳設置為input 輸出信號就設置為output,總的來(lái)說(shuō)就是根據你那個(gè)pin的電器屬性或者說(shuō)在電路中的作用決定的. 但是前提條件是,在你需要仿真調試pcb板的情況下,如果不用仿真的話(huà),完全不用太細究那個(gè)東東 不知道我說(shuō)的對唄,各位老師,前輩指正指正哈 |
我還有個(gè)問(wèn)題,哈哈,老師們不要嫌煩哦! 就是如果在創(chuàng )建allegro裡面元件封裝的話(huà),我怎么確定零件每個(gè)pad,間距,大小什麼的. 因為我看人家話(huà),都直接命令輸入坐標什麼的,比如x 0 1.27之類(lèi)的? 那個(gè)要怎么算啊,如果不用命令輸入坐標,是不是會(huì )不準啊 |
跟著(zhù)學(xué)習…… |
沒(méi)錯,這些邏輯在仿真的時(shí)候有用,如果只是PCB設計的話(huà)沒(méi)必要定義這么全,不過(guò)話(huà)說(shuō)回來(lái),做一次就做好唄 |
老師,定義管教類(lèi)型是不是只有仿真的時(shí)候有用? 如果我不需要仿真的話(huà),是不是管教類(lèi)型可以隨便選? |
很明顯你同樣的管腳定義成了一個(gè)信號名的,你定義成VDDMOP1 VDDMOP2這樣就不會(huì )有報警了。 第二個(gè)問(wèn)題,管腳的類(lèi)型,我給解釋一下上面的圖依次是三態(tài)門(mén),雙向信號,輸入,開(kāi)路集電極,開(kāi)路發(fā)射極,輸出,無(wú)源端,電源 不知道你對上面這些信號端的定義是否了解。 |