Verilog數字系統設計-RTL綜合、測試平臺與驗證(第二版)

發(fā)布時(shí)間:2010-7-28 15:24    發(fā)布者:techieboy
zhaokuiman 發(fā)表于 2011-4-8 06:39:56
zhaokuiman 發(fā)表于 2011-4-8 06:40:26
真好
hjhua_1984 發(fā)表于 2011-4-15 09:37:49
學(xué)習了呵呵
hjhua_1984 發(fā)表于 2011-4-15 09:38:05
看看電子版如何,謝謝分享
lz_study 發(fā)表于 2011-9-22 11:11:37
不錯。就是抱太多拉。
lz_study 發(fā)表于 2011-9-22 11:15:41
很感謝,慢慢下啦。
jimcmwang 發(fā)表于 2015-3-31 15:07:51
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jimcmwang 發(fā)表于 2015-3-31 15:10:53
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huwu2002 發(fā)表于 2015-3-31 19:55:54
你的頭像真好。。。
jimcmwang 發(fā)表于 2019-6-2 21:09:13
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jimcmwang 發(fā)表于 2019-6-5 14:06:24
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jimcmwang 發(fā)表于 2019-6-5 14:08:03
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jimcmwang 發(fā)表于 2019-6-14 08:04:04
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