最經(jīng)典Verilog教程:精通Verilog HDL:IC設計核心技術(shù)實(shí)例詳解

發(fā)布時(shí)間:2010-11-4 13:50    發(fā)布者:wp1981
health 發(fā)表于 2011-10-21 11:26:02
好的
shengjun066 發(fā)表于 2011-11-5 15:27:35
yes,good job
liulanqm 發(fā)表于 2011-11-23 15:39:10
THANKS
liulanqm 發(fā)表于 2011-11-23 15:39:42
多謝
hbjswh 發(fā)表于 2011-12-27 21:03:49
這個(gè)要頂
ztf1978286 發(fā)表于 2012-1-9 08:17:22
學(xué)習了,多謝
ztf1978286 發(fā)表于 2012-1-9 08:23:53
學(xué)習
ztf1978286 發(fā)表于 2012-1-9 08:24:47
學(xué)習
ztf1978286 發(fā)表于 2012-1-9 08:25:59
再學(xué)習一次!
xiaoleisl 發(fā)表于 2012-1-9 16:04:40
hehe
haihu608 發(fā)表于 2012-2-11 18:16:41
謝謝樓主
higoogle 發(fā)表于 2012-2-23 22:15:12
這個(gè)要看看的
juyong 發(fā)表于 2012-5-17 10:03:55
thanks~~
rinllow6 發(fā)表于 2012-10-9 23:41:53
謝謝!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!!
killerljj 發(fā)表于 2012-11-22 21:42:27
不錯。。。!
crablet 發(fā)表于 2013-3-4 15:36:51
感謝樓主……
yuhuikeji 發(fā)表于 2014-10-17 14:59:03
學(xué)習了,多謝
jimcmwang 發(fā)表于 2014-10-27 10:24:03
精通Verilog HDL:IC設計核心技術(shù)實(shí)例詳解.part1.rar
jimcmwang 發(fā)表于 2014-10-27 10:24:22
精通Verilog HDL:IC設計核心技術(shù)實(shí)例詳解.part2.rar
jimcmwang 發(fā)表于 2014-10-27 10:24:38
精通Verilog HDL:IC設計核心技術(shù)實(shí)例詳解.part3.rar
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