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薄膜器件適合芯片粘結或引線(xiàn)鍵合，線(xiàn)路寬度和間隔小于0.003英寸，公差低至±0.001英寸 Vishay定制薄膜基板新增加一種側邊圖形化---SDWP基板，使Vishay能夠用小的線(xiàn)路寬度和間隔尺寸，在基板的最多4個(gè)表面上制造出導電圖形，可在國防、航天、醫療和電信設備里提高設計靈活性和密度，以實(shí)現小型化。 
不像采用鍍層或填孔的傳統方法，Vishay Dale Resistors Electro-Films產(chǎn)品線(xiàn)使用能在側邊和上表面進(jìn)行芯片粘結或引線(xiàn)鍵合的SDWP基板。與引線(xiàn)鍵合相比，側邊圖形連接的電感更低，因此在高頻下工作得更好，使得這些器件非常適合機電或光電應用里的定制電路，射頻應用中的高頻電路，以及高比特率收發(fā)器(TOSA/ROSA)。 使用這種基板，設計者可以在芯片的上表面和下表面之間實(shí)現連續的導電圖形，把引線(xiàn)鍵合連到芯片側邊的印制線(xiàn)上，或用pin腳與芯片的側邊實(shí)現接觸。SDWP還能讓設計者把芯片安裝在基板上，在直立組裝中定位基板的位置，且引線(xiàn)鍵合放到變成基板“上表面”的地方，這樣就能與產(chǎn)品里的光纖、棱鏡和透鏡等光學(xué)元件實(shí)現更好的集成。 SDWP基板的鍍層厚度小于0.025英寸，最小線(xiàn)寬和間隔小于0.003英寸，線(xiàn)寬和間隔公差低至±0.001英寸。與厚膜方案相比，薄膜器件的導線(xiàn)寬度和間隔尺寸小2到3倍，并且尺寸公差更嚴�；迨褂昧硕喾N金屬材料，包括TiW/Au/Au鍍層、TiW/Au/Ni鍍層/Au鍍層，以及Cr/Cu/Cu鍍層/Ni鍍層/Au鍍層。 SDWP基板現可提供樣品，并已實(shí)現量產(chǎn)，供貨周期為四周。 |
