用I/O口模擬IIC總線(xiàn)協(xié)議遇到的一些問(wèn)題

發(fā)布時(shí)間:2016-10-20 15:31    發(fā)布者:designapp
關(guān)鍵詞: IIC , 總線(xiàn)協(xié)議
最近做的一個(gè)項目,是基于IIC總線(xiàn)通信的傳感器系統。由于另外一個(gè)傳感器使用的是類(lèi)IIC協(xié)議,而不是標準IIC,所以MCU不能與其通信,最后沒(méi)有辦法,只有通過(guò)I/O口模擬的方式實(shí)現IIC的總線(xiàn)通信。具體的程序在我博客里在先前的早些時(shí)候已經(jīng)貼出來(lái)了,如果有興趣的可以查看我的博客。

主要終結一下我在這個(gè)過(guò)程中遇見(jiàn)的問(wèn)題

1、在寫(xiě)完數據(指令或者地址)后 沒(méi)有應答信號

一般開(kāi)始的時(shí)序根據手冊里面的時(shí)序圖很容易可以寫(xiě)出,第一個(gè)沒(méi)有應答,就有可能向從器件寫(xiě)完數據以后。一般這個(gè)時(shí)候主要檢查的是,上升沿和下降沿,看手冊里面說(shuō)的是上升沿讀寫(xiě)還是下降沿讀寫(xiě)。我的項目中是上升沿讀寫(xiě)數據,換一句話(huà)說(shuō),在上升沿的時(shí)候讀寫(xiě)SDA線(xiàn)上的電平指示;下降沿的時(shí)候改變數據,其中有一點(diǎn)需要注意,就是先拉低SCL線(xiàn)產(chǎn)生下降沿,在程序中拉低之后要有一定的延時(shí),因為I/O口穩定電平需要一定的時(shí)間。不然的話(huà)在SDA高的情況下,誤拉低了SCL就會(huì )產(chǎn)生一個(gè)啟動(dòng)條件,自然寫(xiě)入的操作也就失敗了。

2、在讀取數據的時(shí)候數據不對

這樣的情況是有數據但是不是有效的數據,一般這個(gè)時(shí)候就要看模擬的時(shí)序是否對了,要明確的在上升沿的時(shí)刻讀取數據,而后注意的就是數據移位,每讀取一位數據之后就要移位一個(gè)數據位,下面就是一段讀取8位數據的代碼。

for(i=0;iI/O操作的過(guò)程中,高低電平如何書(shū)寫(xiě)

輸入輸出的I/O口都是有方向的,要注意方向的書(shū)寫(xiě),推薦的一種寫(xiě)法就是高電平的寫(xiě)的時(shí)候將I/O配置為輸入,這樣上拉的作用就會(huì )向總線(xiàn)輸出高電平,這樣的好處就是可以在寫(xiě)完之后可以等待從器件對總線(xiàn)的操作,不會(huì )產(chǎn)生一定的沖突。下面就是一段高地電平的寫(xiě)法

#define IIC_SCL_HIGH() IIC_SCL_DIR = PORT_INPUT //時(shí)鐘線(xiàn)拉高

#define IIC_SCL_LOW() IIC_SCL_DIR = PORT_OUTPUT;IIC_SCL=0//時(shí)鐘線(xiàn)拉低

#define IIC_SDA_HIGH() IIC_SDA_DIR = PORT_INPUT //數據線(xiàn)拉高

#define IIC_SDA_LOW() IIC_SDA_DIR = PORT_OUTPUT;IIC_SDA=0//數據線(xiàn)拉低
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