最經(jīng)典Verilog教程：精通Verilog HDL：IC設計核心技術(shù)實(shí)例詳解

發(fā)布時(shí)間：2010-11-4 13:50    發(fā)布者：wp1981
關(guān)鍵詞： verilog
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精通Verilog HDL：IC設計核心技術(shù)實(shí)例詳解.part1.rar (12.11 MB)
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rinllow3 發(fā)表于 2010-11-4 14:01:46
thanks
jjj222777 發(fā)表于 2010-11-4 19:46:46
謝謝分享
jjj222777 發(fā)表于 2010-11-4 20:02:30
怎么還差part7??????
zhaghie 發(fā)表于 2010-11-4 20:11:08
是啊
part7呢？

樓主別逗了，下載6個(gè)沒(méi)用的...
wp1981 發(fā)表于 2010-11-4 22:18:21
抱歉，重新上傳了
hg527 發(fā)表于 2010-11-5 15:27:16
飛思科技產(chǎn)品研發(fā)中心 得頂 必須的。。。。。
jinfangwang 發(fā)表于 2010-11-8 23:09:36
學(xué)習了，多謝
fengyxuey 發(fā)表于 2010-11-12 15:34:09
這個(gè)東西真的不好找
darrenlocust1 發(fā)表于 2010-11-12 15:58:52
頂
darrenlocust1 發(fā)表于 2010-11-12 15:59:23
頂
darrenlocust1 發(fā)表于 2010-11-12 15:59:50
頂
darrenlocust1 發(fā)表于 2010-11-12 16:00:37
頂
darrenlocust1 發(fā)表于 2010-11-12 16:01:18
學(xué)習了，多謝
chenmi 發(fā)表于 2010-11-15 13:51:50
謝謝樓主
chenmi 發(fā)表于 2010-11-15 14:07:51
謝謝樓主
higoogle 發(fā)表于 2010-11-21 13:34:27
  先下了再說(shuō)
mdtjason 發(fā)表于 2010-11-23 13:51:53
thanks~~
mdtjason 發(fā)表于 2010-11-23 14:16:48
thanks~~~
mdtjason 發(fā)表于 2010-11-23 14:19:26
thanks~~
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