基于FPGA的verilog萬(wàn)年歷程序_萬(wàn)年歷設計_明德?lián)P資料

發(fā)布時(shí)間:2017-8-2 17:11    發(fā)布者:mdykj33
工程說(shuō)明
FPGA設計中,數字萬(wàn)年歷屬于小規模集成電路。從原理上來(lái)講,是典型的數字電路,包括組合邏輯電路和時(shí)序電路;贔PGA開(kāi)發(fā)除設計簡(jiǎn)便、開(kāi)發(fā)成本低、電路簡(jiǎn)潔等,更具備功能設計靈活方面的優(yōu)勢。

案例補充說(shuō)明
萬(wàn)年歷是記錄一定時(shí)間范圍內的年歷,其名稱(chēng)只是一種象征,表示時(shí)間跨度大。由于其功能非常常用,且極為方便人們查詢(xún)使用,因此廣泛應用于鐘表、歷書(shū)出版物、電子產(chǎn)品、電腦軟件和手機應用等行業(yè)中。


代碼文檔說(shuō)明
至簡(jiǎn)設計法--萬(wàn)年歷.rar (56.45 KB)
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