從0開(kāi)始學(xué)習CPLD和Verilog

發(fā)布時(shí)間：2011-4-29 11:13    發(fā)布者：mabaolin2008
關(guān)鍵詞： CPLD , Verilog
從0開(kāi)始學(xué)習CPLD和Verilog

從零開(kāi)始學(xué) CPLD 和 Verilog HDL 編程技術(shù)...rar

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rinllow5 發(fā)表于 2011-4-29 22:44:28
謝謝�。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。�！
lising 發(fā)表于 2011-5-6 23:03:39
謝謝分享
bashao 發(fā)表于 2011-5-10 14:53:39
不錯
shalione 發(fā)表于 2011-5-20 11:31:12
youyou_zh 發(fā)表于 2011-6-10 19:02:51
kankan
klyzh2003 發(fā)表于 2011-6-12 18:15:00
謝謝誒！
china178 發(fā)表于 2011-6-19 20:36:36
免費是王道啊，不過(guò)還是謝謝樓主分享。
yefegn 發(fā)表于 2011-6-28 07:17:27
回復2樓rinllow5：
頂，這可是入門(mén)級資料了。
NIUPAI 發(fā)表于 2011-8-6 11:22:58
謝謝�。。�！
xyda123456789 發(fā)表于 2011-8-19 19:38:47
謝謝樓主分享！
blackground 發(fā)表于 2011-8-24 21:01:27
謝謝分享
mayo2012 發(fā)表于 2011-11-13 21:46:23
xiexie lou zhu
univercity 發(fā)表于 2011-11-24 13:30:34
謝謝，學(xué)習了！
waytonwoo 發(fā)表于 2012-3-9 15:59:12
good
i like it
thks
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