芯華章發(fā)布高性能FPGA雙模驗證系統

發(fā)布時(shí)間:2022-12-5 10:09    發(fā)布者:eechina
關(guān)鍵詞: 芯華章 , FPGA , 雙模驗證
來(lái)源:TechWeb

12月4日消息,國內系統級驗證EDA解決方案提供商芯華章正式發(fā)布高性能FPGA雙模驗證系統樺捷HuaPro P2E,以獨特的雙模式滿(mǎn)足系統調試和軟件開(kāi)發(fā)兩方面的需求,解決了原型驗證與硬件仿真兩種驗證工具的融合平衡難題,是硬件驗證系統的一次重大突破性創(chuàng )新,將極大助力軟硬件協(xié)同開(kāi)發(fā),賦能大規模復雜系統應用創(chuàng )新。

作為新一代FPGA雙模驗證系統,樺捷HuaPro P2E通過(guò)統一軟硬件平臺支持硬件仿真與原型驗證雙工作模式,幫助開(kāi)發(fā)團隊突破了傳統軟硬件驗證工具的割裂限制。這得益于芯華章自主研發(fā)的一體化、全自動(dòng)HPE Compiler,支持大規模設計的自動(dòng)綜合、智能分割、優(yōu)化實(shí)現,并支持深度調試、無(wú)限量、任意深度的信號波形采集、動(dòng)態(tài)觸發(fā)、內存加載和讀取等多種調試能力。

HPE Compiler為HuaPro P2E融合多種驗證場(chǎng)景打造了堅實(shí)的技術(shù)基礎,在實(shí)際測試中,可通過(guò)一鍵式流程縮短30%-50%的驗證周期,從而大大降低開(kāi)發(fā)成本,助力大規模系統級芯片設計效率提升。
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