研發(fā)VP(高速通信芯片方向)

發(fā)布時(shí)間:2023-9-8 16:48    發(fā)布者:KT咨詢(xún)
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任職要求:
1 英文聽(tīng)說(shuō)讀寫(xiě)流利。
2.電子工程專(zhuān)業(yè)研究生或者博士學(xué)位,10年以上高速模擬/微波設計經(jīng)驗。
3.Cadence設計經(jīng)驗- Virtuoso, Assura and Spectre。運算放大器、高速模擬電路、鎖相環(huán)、驅動(dòng)電路、超簡(jiǎn)單放大器等混合信號集成電路的設計與測試。有使用實(shí)驗室測試設備如網(wǎng)絡(luò )分析儀、混合信號集成電路和器件的示波器的經(jīng)驗者優(yōu)先。有管理模擬/布局設計工程師團隊的經(jīng)驗。
4.了解電路概念,半導體器件物理,微波理論,高速集成電路布局考慮和控制理論

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