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verilog快速掌握新版 簡(jiǎn)介 VerilogHDL作為一種硬件描述語(yǔ)言是我們在學(xué)習FPGA時(shí)所必須掌握的工具之一。雖然Verilog HDL的最大優(yōu)點(diǎn)是易學(xué)易用，但是由于其語(yǔ)法較為自由，因此初學(xué)者在使用的過(guò)程中容易犯一些錯誤。 明德?lián)P至簡(jiǎn)設計法由擁有多年FPGA代碼編寫(xiě)經(jīng)驗的潘文明老師首創(chuàng )，不僅能讓初學(xué)者在短時(shí)間內掌握Verilog語(yǔ)言，而且編寫(xiě)出的代碼簡(jiǎn)潔無(wú)冗余、準確度高。我們將通過(guò)一系列案例，讓您得到關(guān)于Verilog的高效點(diǎn)撥。 01 D觸發(fā)器及代碼 本視頻講述了編寫(xiě)FPGA程序最重要的基礎——D觸發(fā)器。很多同學(xué)覺(jué)得要把數字電路基礎學(xué)完，才能學(xué)習FPGA。實(shí)際上，很多知識是不需要用到的，我們只要清楚D觸發(fā)器就足夠了。大家通過(guò)學(xué)習本視頻之后便可以開(kāi)始著(zhù)手寫(xiě)代碼，無(wú)需再浪費大量的時(shí)間去學(xué)習理論知識，實(shí)踐才能出真知！ 02 FPGA設計思維 什么是FPGA設計思維呢？本視頻可以告訴你，教您區別、理解硬件思維和軟件思維的不同，讓你全方位掌握FPGA的設計思路。 03 我們的第一個(gè)設計 當你看到一個(gè)項目要求之后，如何設計呢？也許你自己感覺(jué)已經(jīng)懂了，于是在模模糊糊的情況下就開(kāi)始寫(xiě)代碼，沒(méi)有清晰步驟，最后需要反復打補丁才完成？ 本視頻通過(guò)一個(gè)簡(jiǎn)單的例子告訴你如何正確地設計，手把手教你設計的思路、過(guò)程。 04 我們的第一個(gè)設計思路 明德?lián)P根據多年項目和培訓經(jīng)驗，總結和制定了一套科學(xué)嚴謹的計數器規則。只要按照我們的“計數器架構八步法”，一步步考慮你的設計，就完全不存在無(wú)思路、無(wú)從下手的問(wèn)題。本視頻主要通過(guò)一個(gè)案例來(lái)闡述明德?lián)P“計數器架構八步法”如何實(shí)現代碼的全過(guò)程，即便您是Verilog初學(xué)者，也能快速掌握。 05 第一個(gè)設計語(yǔ)法總結 如今市面上有不少關(guān)于Verilog語(yǔ)法的書(shū)籍，但實(shí)際上我們常用的語(yǔ)法并不多，如果花費大量的時(shí)間和精力去鉆研全部的語(yǔ)法，那么這顯然是不明智的做法。本課程所介紹的語(yǔ)法，可以覆蓋絕大部分的應用，而且完全不影響設計效率。我們視頻通過(guò)總結一些基本的語(yǔ)法應用，讓您掌握至簡(jiǎn)設計法的精髓，幫助您在以后的學(xué)習中打下堅實(shí)的基礎。 06 我們的第二個(gè)設計——串口 本視頻介紹的是串口的發(fā)送模塊的練習要求，讓您在實(shí)踐中掌握至簡(jiǎn)設計法的精髓。 |
