數字驗證工程師

發(fā)布時(shí)間:2023-5-26 14:16    發(fā)布者:KT咨詢(xún)
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崗位職責:
1、根據UVM方法構建testbench,負責數字IP模塊、SOC系統及其子系統的驗證方案輸出,以及驗證環(huán)境的搭建;
2、在全芯片測試環(huán)境中進(jìn)行系統級(SOC)仿真驗證;
3、分析功能/代碼覆蓋結果,并確定覆蓋范圍,提高覆蓋率;
4、負責開(kāi)發(fā)各種驗證模型及驗證組件,定義項目驗證計劃,保證證驗證準確性和完整性。
崗位要求:
1、電子類(lèi)相關(guān)專(zhuān)業(yè),5年以上本科及以上學(xué)歷;
2、熟練使用斷言、功能覆蓋率等常用驗證手段及方法,掌握至少一種主流高級驗證方法學(xué),如VMM/OVM/UVM等;
3、熟臉掌握system Verilog、HDL和各種Shell語(yǔ)言(Perl/csh/tcl/sh等);
4、熟練使用主流EDA驗證工具(VCS、Verdi);
5、對PCle協(xié)議熟練者優(yōu)先;
6、了解完整的驗證流程,包括測試計劃、測試、覆蓋模型等。
福利:五險一金   彈性工作   員工旅游   定期體檢   全勤獎   年終獎金

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