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樓主
發(fā)表于 2012-2-15 22:58:58 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
Verilog HDl和vhdl相比誰(shuí)的優(yōu)勢大一些
沙發(fā)
發(fā)表于 2012-2-16 18:13:08 | 只看該作者
Verilog
板凳
發(fā)表于 2012-2-17 09:47:30 | 只看該作者
Verilog語(yǔ)法簡(jiǎn)單、明了,容易掌握!
地板
發(fā)表于 2012-2-17 21:38:32 | 只看該作者
Verilog在國內用得相對多一些,而且更容易學(xué)。
地下室
發(fā)表于 2012-2-20 09:51:13 | 只看該作者
Verilog更好吧,簡(jiǎn)單易學(xué),容易掌握~~~
6
發(fā)表于 2012-2-20 18:38:43 | 只看該作者
看你的公司把,不國現在一般公司verilog'多些
7
發(fā)表于 2012-3-8 17:16:55 | 只看該作者
打下醬油
8
發(fā)表于 2012-4-8 21:23:59 | 只看該作者
看你做什么,IP CORE中兩種語(yǔ)言都有
9
發(fā)表于 2012-4-8 21:51:11 | 只看該作者
Verilog
10
發(fā)表于 2012-4-8 22:35:03 | 只看該作者
Verilog和VHDL的關(guān)系,有點(diǎn)類(lèi)似于C語(yǔ)言和Pascal語(yǔ)言
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