高級verilog RTL 設計指導 STARC RTL STYLE GUIDE

發(fā)布時(shí)間：2014-12-30 14:10    發(fā)布者：看門(mén)狗
關(guān)鍵詞： verilog , RTL
本資料是由半導體設計協(xié)會(huì )專(zhuān)門(mén)為IC設計工程師們所編寫(xiě)的rtl設計規范。本書(shū)中涉及到信號命名規則，同步異步信號處理，以及testbench編寫(xiě)方法，scan時(shí)相關(guān)信號處理，以及dc綜合時(shí)的相關(guān)注意事項等等。

STARC RTL STYLE GUIDE.pdf (7.12 MB)

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rinllow6 發(fā)表于 2014-12-31 14:42:05
謝謝�。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。。�！
jimcmwang 發(fā)表于 2019-6-3 13:04:23
STARC RTL STYLE GUIDE.pdf (7.12 MB, 下載次數: 111)
shancjb 發(fā)表于 2020-5-29 19:04:43
dingyige xian
devinzeng 發(fā)表于 2022-10-14 14:35:41
謝謝分享！
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