Verilog HDL - A Guide to Digital Design and Synthesis

發(fā)布時(shí)間：2010-10-12 22:48 發(fā)布者：看門(mén)狗

關(guān)鍵詞： HDL , verilog

Verilog HDL初、中級經(jīng)典書(shū)籍

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網(wǎng)友評論

rinllow3 發(fā)表于 2010-10-12 23:06:27

thanks

hongsayang 發(fā)表于 2010-10-12 23:45:23

THANKS

owen70080 發(fā)表于 2010-10-14 20:26:23

thanks

wangqi490789 發(fā)表于 2010-10-15 20:25:02

thinks

xuwenqiang 發(fā)表于 2010-10-16 08:27:20

謝謝

fymbl 發(fā)表于 2010-10-16 11:46:31

very good .

wnj0925 發(fā)表于 2010-10-16 17:11:23

thanks

ordman10 發(fā)表于 2010-10-16 19:38:20

好書(shū)。

yangtao0559 發(fā)表于 2010-10-17 07:33:34

悲劇了 �。�！扣了分沒(méi)下來(lái)

yangtao0559 發(fā)表于 2010-10-17 07:33:56

第二次總算下來(lái)了�。。。。。�！

zzytyy1023 發(fā)表于 2010-10-17 19:01:09

謝謝，看看

wxw123321 發(fā)表于 2010-10-17 20:11:44

好書(shū)。

hkhxj 發(fā)表于 2010-10-20 08:25:22

謝謝分享！

yacclex 發(fā)表于 2010-10-20 08:56:49

thanks

cityfish 發(fā)表于 2010-10-20 16:14:05

謝謝樓主分享

zhmmhz 發(fā)表于 2010-10-24 21:00:39

hahahhahhahah

sagetom 發(fā)表于 2010-10-25 15:12:57

很好的東西，值得大家學(xué)習其先進(jìn)經(jīng)驗。

kunhsun 發(fā)表于 2010-10-27 00:37:36

thanks

zouzhanghui 發(fā)表于 2010-10-27 10:28:38

謝謝提供

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