CAST和Achronix使用無(wú)損壓縮IP支持從數據中心到邊緣的數據處理

發(fā)布時(shí)間:2018-5-2 14:56    發(fā)布者:eechina
關(guān)鍵詞: eFPGA , 無(wú)損壓縮 , ZipAccel , Speedcore
將CAST的壓縮知識產(chǎn)權(IP)與Achronix的eFPGA技術(shù)集成在高性能、低功耗解決方案中,以支持大數據的移動(dòng)和存儲

Achronix半導體公司與CAST Incorporated達成合作;CAST的高性能無(wú)損壓縮IP已經(jīng)被植入,以支持Achronix 的FPGA產(chǎn)品組合,用來(lái)完成數據中心和移動(dòng)邊緣間數據傳輸的高效處理。

CAST為Deflate、GZIP和ZLIB等無(wú)損壓縮工具提供標準的硬件實(shí)現,它們與用于壓縮或解壓的軟件實(shí)現方式兼容。ZipAccel內核提供的硬件實(shí)現可提供高達100Gbps的高吞吐量,且擁有非常高的壓縮性能和低延遲。將其與Achronix的Speedcore eFPGA技術(shù)耦合在一起,可實(shí)現一種可更加便捷地移動(dòng)和存儲大數據的高性能、低功耗解決方案。

隨著(zhù)帶有解析的應用呈現爆炸式增長(cháng),通過(guò)帶寬有限的通信通道去傳輸越來(lái)越多的信息廣泛地出現在從汽車(chē)系統到大型金融機構等很多場(chǎng)景中。傳輸數據的成本和功耗變得越來(lái)越重要,使用Achronix eFPGA來(lái)實(shí)現的壓縮功能可將功耗降到最低并使網(wǎng)絡(luò )能力最大化。在客制化SoC中,將CAST壓縮IP和Speedcore eFPGA IP結合在一起,可有效地提升可實(shí)現的吞吐量;此外,開(kāi)發(fā)人員可利用eFPGA去快速且高效地實(shí)現數據處理算法。

為了應對系統的特定吞吐量、存儲和延遲需求,能夠在eFPGA中優(yōu)化壓縮算法,將使該解決方案成為數百種應用場(chǎng)景的可選技術(shù)。這不僅可以增加吞吐量,而且可以實(shí)現昂貴的內存存儲空間的顯著(zhù)節省。

“我們非常高興能夠與CAST合作,來(lái)進(jìn)一步豐富Achronix的合作伙伴計劃,” Achronix產(chǎn)品規劃和業(yè)務(wù)拓展高級總監Mike Fitton說(shuō)道!澳軌蛟谖覀兊膃FPGA中將CAST的高吞吐量壓縮內核實(shí)例化,將支持帶有Speedcore的ASIC和SoC去有效地滿(mǎn)足數據服務(wù)市場(chǎng)。由于有了eFPGA IP來(lái)作為面向特定工作負載的、可重復編程的硬件加速器,從而使包括壓縮以及包括數據解析等全新算法即刻被快速實(shí)現。Speedcore eFPGA的高性能加上其巨大的市場(chǎng)牽引力使其成為該類(lèi)應用的理想選擇!

“CAST很高興地將內核授權給Achronix的客戶(hù),他們將受益于A(yíng)chronix的獨特架構,可以為全新的算法提供高度靈活性和永不過(guò)時(shí)的能力,并實(shí)現快速上市,”CAST有限公司首席執行官Nikos D. Zervas評論道!巴ㄟ^(guò)為Achronix FPGA工具鏈和架構提供經(jīng)過(guò)驗證的IP解決方案,為我們那些要求在A(yíng)chronix的FPGA和eFPGA中實(shí)現這些功能的客戶(hù)節省了開(kāi)發(fā)時(shí)間。該IP已被進(jìn)一步優(yōu)化以充分利用Achronix的FPGA架構來(lái)實(shí)現加速并縮減芯片面積!

ZipAccel-C靈活的架構允許對其壓縮效率、吞吐量、占位面積和延遲進(jìn)行微調,來(lái)滿(mǎn)足終端應用的需求。CAST的工程師通過(guò)提供數據和分析服務(wù),來(lái)幫助用戶(hù)決定內核的不同配置之間的權衡,并對客戶(hù)特定數據樣本的評估提供支持。


Speedcore嵌入式FPGA(eFPGA)IP產(chǎn)品可以被集成到ASIC或者SoC之中,以提供定制的可編程芯片結構?蛻(hù)通過(guò)細化其所需的邏輯功能、存儲器和DSP資源,然后Achronix將配置Speedcore IP以滿(mǎn)足其個(gè)性化的需求。Speedcore查找表(LUT)、RAM單元和DSP64單元可以像積木一樣組裝起來(lái),從而為任何應用創(chuàng )建最優(yōu)化的可編程功能結構。
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