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近年來(lái)，通訊技術(shù)、計算機技術(shù)的發(fā)展越來(lái)越快，高速數字電路在設計中的運用越來(lái)越多，數字接入設備的交換能力已從百兆、千兆發(fā)展到幾十千兆。高速數字電路設計對信號完整性技術(shù)的需求越來(lái)越迫切。 在中、大規模電子系統的設計中，系統地綜合運用信號完整性技術(shù)可以帶來(lái)很多好處，如縮短研發(fā)周期、降低產(chǎn)品成本、降低研發(fā)成本、提高產(chǎn)品性能、提高產(chǎn)品可靠性。 數字電路在具有邏輯電路功能的同時(shí)，也具有豐富的模擬特性，電路設計工程師需要通過(guò)精確測定、或估算各種噪聲的幅度及其時(shí)域變化，將電路抗干擾能力精確分配給各種噪聲，經(jīng)過(guò)精心設計和權衡，控制總噪聲不超過(guò)電路的抗干擾能力，保證產(chǎn)品性能的可靠實(shí)現。 為了滿(mǎn)足中興上研一所的科研需要，我們在去年和今年關(guān)于信號完整性技術(shù)合作的基礎上，克服時(shí)間緊、任務(wù)重的困難，編寫(xiě)了這份硬件設計培訓系列教材的“信號完整性”部分。由于我們的經(jīng)驗和知識所限，這部分教材肯定有不完善之處，歡迎廣大讀者和專(zhuān)家批評指正。 本教材的對象是所內硬件設計工程師，針對我所的實(shí)際情況，選編了第一章——導論、第二章——數字電路工作原理、第三章——傳輸線(xiàn)理論、第四章——直流供電系統設計，相信會(huì )給大家帶來(lái)益處。同時(shí)，也希望通過(guò)我們的不懈努力能消除大家在信號完整性方面的煩腦。 |
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